本書根據(jù)新工科人才培養(yǎng)要求與新技術發(fā)展現(xiàn)狀，對模擬電子技術課程的知識體系進行了重構，將紙質書與新形態(tài)元素緊密結合，形成立體化教材。本書編寫思路是“基本器件→基本電路→集成電路→典型應用電路”，即從半導體器件入手，討論放大電路的結構、分析方法和性能指標，并在介紹模擬集成放大電路各個單元模塊的基礎上，分析運放的工作狀態(tài)和典型應用等。本書共9章：緒論、半導體器件基礎、基本放大電路、放大電路的頻率響應、負
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內容簡介
本書符合教育部高等學?！半姽る娮踊A課程教學指導分委員會”于2019年制定的“數(shù)字電子技術基礎”課程教學基本要求，以“保證基礎，精選內容，重視應用”為目標，立足現(xiàn)代數(shù)字電子技術的發(fā)展和我國高等教育人才培養(yǎng)目標，力求反映當前數(shù)字電子技術發(fā)展的主流和趨勢。 全書共11章，主要內容包括數(shù)字邏輯基礎、邏輯代數(shù)、組合邏輯電路、鎖存器和觸發(fā)器、時序邏輯電路、硬件描述語言Verilog HDL、邏輯門電路、半導體存儲器、可編程邏輯器件、數(shù)模轉換器和模數(shù)轉換器、脈沖波形的變換與產生。本書采用先“邏輯”、后“電路”的次序安排內容，遵循“由淺入深，循序漸進”的學習規(guī)律，力求做到通俗易懂，激發(fā)讀者學習的主觀能動性。 本書可作為普通高等學校電子信息類、電氣類、自動化類等相關專業(yè)“數(shù)字電子技術基礎”課程的教材，也可作為從事電子技術工作的工程技術人員的參考書。
章節(jié)目錄
- 封面
- 扉頁
- 版權信息
- 內容提要
- 前言
- 第1章 數(shù)字邏輯基礎
- 1.1 數(shù)字信號的基本概念
- 1.1.1 模擬信號與數(shù)字信號
- 1.1.2 數(shù)字信號的描述方法
- 1.2 數(shù)制及其相互轉換
- 1.2.1 幾種常用的數(shù)制
- 1.2.2 數(shù)制轉換
- 1.3 二進制數(shù)的算術運算
- 1.3.1 無符號二進制數(shù)的算術運算
- 1.3.2 有符號二進制數(shù)的表示
- 1.3.3 二進制補碼的減法運算
- 1.4 碼制
- 1.4.1 二—十進制碼
- 1.4.2 格雷碼
- 1.4.3 奇偶校驗碼
- 1.4.4 ASCII
- 1.5 邏輯運算及邏輯門
- 1.5.1 基本邏輯運算及對應的邏輯門
- 1.5.2 常用復合邏輯運算及對應的邏輯門
- 1.5.3 邏輯門的應用
- 1.6 集成邏輯門簡介
- 1.6.1 數(shù)字集成電路簡介
- 1.6.2 常用的集成邏輯門
- 1.6.3 集成邏輯門電路的一般特性
- 小結
- 自我檢驗題
- 習題
- 實踐訓練
- 第2章 邏輯代數(shù)
- 2.1 邏輯代數(shù)的基本公式和規(guī)則
- 2.1.1 邏輯代數(shù)的基本公式
- 2.1.2 邏輯代數(shù)的基本規(guī)則
- 2.2 邏輯函數(shù)的代數(shù)化簡法
- 2.2.1 邏輯函數(shù)的最簡形式
- 2.2.2 用代數(shù)法化簡邏輯函數(shù)
- 2.3 邏輯函數(shù)的兩種標準形式
- 2.3.1 最小項與最小項表達式
- ?2.3.2 最大項與最大項表達式
- 2.4 邏輯函數(shù)的卡諾圖化簡法
- 2.4.1 用卡諾圖表示邏輯函數(shù)
- 2.4.2 用卡諾圖化簡邏輯函數(shù)
- 2.4.3 含無關項的邏輯函數(shù)及其化簡
- 2.4.4 多輸出邏輯函數(shù)的化簡
- 2.5 邏輯門符號的等效變換
- 小結
- 自我檢驗題
- 習題
- 實踐訓練
- 第3章 組合邏輯電路
- 3.1 概述
- 3.2 組合邏輯電路的分析
- 3.3 組合邏輯電路的設計
- 3.4 常用組合邏輯電路
- 3.4.1 編碼器
- 3.4.2 譯碼器/數(shù)據(jù)分配器
- 3.4.3 數(shù)據(jù)選擇器
- 3.4.4 數(shù)值比較器
- 3.4.5 加法器
- *3.5 組合邏輯電路的競爭—冒險
- 3.5.1 競爭—冒險現(xiàn)象及產生的原因
- 3.5.2 消去競爭—冒險的方法
- 3.6 應用舉例：搶答器電路
- 小結
- 自我檢驗題
- 習題
- 實踐訓練
- 第4章 鎖存器和觸發(fā)器
- 4.1 雙穩(wěn)態(tài)電路的基本特性
- 4.2 鎖存器
- 4.2.1 基本SR鎖存器
- 4.2.2 門控SR鎖存器
- 4.2.3 門控D鎖存器
- 4.3 觸發(fā)器的電路結構和工作原理
- 4.3.1 主從D觸發(fā)器
- 4.3.2 有清零輸入和置數(shù)輸入的D觸發(fā)器
- 4.3.3 帶使能端的D觸發(fā)器
- 4.4 觸發(fā)器的邏輯功能
- 4.4.1 D觸發(fā)器
- 4.4.2 JK觸發(fā)器
- 4.4.3 T觸發(fā)器
- 4.4.4 T′觸發(fā)器
- *4.5 觸發(fā)器的動態(tài)特性
- 4.6 應用舉例：會客廳照明燈控制電路
- 小結
- 自我檢驗題
- 習題
- 實踐訓練
- 第5章 時序邏輯電路
- 5.1 概述
- 5.1.1 時序邏輯電路的基本結構及特點
- 5.1.2 時序邏輯電路的分類
- 5.2 時序邏輯電路分析
- 5.2.1 時序邏輯電路分析的一般步驟
- 5.2.2 同步時序邏輯電路分析舉例
- 5.2.3 異步時序邏輯電路分析舉例
- 5.3 同步時序邏輯電路設計
- 5.3.1 同步時序邏輯電路設計的一般步驟
- 5.3.2 同步時序邏輯電路設計舉例
- 5.4 寄存器和移位寄存器
- 5.4.1 寄存器
- 5.4.2 移位寄存器
- 5.4.3 集成移位寄存器及其應用
- 5.5 計數(shù)器
- 5.5.1 異步計數(shù)器
- 5.5.2 同步計數(shù)器
- 5.5.3 集成計數(shù)器及其應用
- *5.6 序列信號發(fā)生器
- 5.6.1 計數(shù)型序列信號發(fā)生器
- 5.6.2 移存型序列信號發(fā)生器
- 5.7 應用舉例：籃球競賽24s定時電路
- 小結
- 自我檢驗題
- 習題
- 實踐訓練
- 第6章 *硬件描述語言Verilog HDL
- 6.1 概述
- 6.2 Verilog HDL入門
- 6.2.1 Verilog HDL的基本結構
- 6.2.2 簡單Verilog HDL實例
- 6.2.3 邏輯功能的仿真與測試
- 6.3 Verilog HDL基本語法
- 6.3.1 詞法規(guī)定
- 6.3.2 邏輯值集合與常量的表示
- 6.3.3 數(shù)據(jù)類型
- 6.4 Verilog HDL結構級建模
- 6.4.1 多輸入門
- 6.4.2 多輸出門
- 6.4.3 三態(tài)門
- 6.4.4 門級建模舉例
- 6.4.5 分層次的電路設計方法
- 6.5 Verilog HDL數(shù)據(jù)流建模
- 6.5.1 數(shù)據(jù)流建模語法
- 6.5.2 帶有參數(shù)的組合邏輯電路建模
- 6.5.3 Verilog HDL運算符
- 6.5.4 運算符的優(yōu)先級別
- 6.6 Verilog HDL行為級建模
- 6.6.1 行為級建?；A
- 6.6.2 觸發(fā)器與移位寄存器的行為級建模
- 6.6.3 計數(shù)器的行為級建模
- 6.6.4 狀態(tài)圖的行為級建模
- 6.7 應用舉例：數(shù)字鐘電路設計
- 小結
- 自我檢驗題
- 習題
- 實踐訓練
- 第7章 邏輯門電路
- 7.1 CMOS邏輯門電路
- 7.1.1 MOS管的開關特性
- 7.1.2 CMOS反相器
- 7.1.3 CMOS與非門和或非門
- 7.1.4 CMOS傳輸門
- 7.1.5 CMOS三態(tài)輸出門和漏極開路輸出門
- 7.2 TTL邏輯門電路
- 7.2.1 BJT的開關特性
- 7.2.2 TTL反相器
- 7.2.3 TTL與非門和或非門
- 7.3 邏輯門電路使用中的實際問題
- 7.3.1 各種邏輯門電路之間的接口問題
- 7.3.2 邏輯門電路帶負載時的接口電路
- 7.3.3 抗干擾措施
- 7.3.4 差分信號傳輸
- 小結
- 自我檢驗題
- 習題
- 實踐訓練
- 第8章 半導體存儲器
- 8.1 存儲器的基本概念
- 8.1.1 存儲器的基本結構
- 8.1.2 存儲器的分類及性能指標
- 8.2 只讀存儲器
- 8.2.1 固定ROM
- 8.2.2 ROM的分類
- 8.2.3 ROM的應用
- 8.3 隨機存取存儲器
- 8.3.1 RAM的基本結構
- 8.3.2 SRAM存儲單元
- 8.3.3 DRAM存儲單元
- 8.3.4 同步RAM
- 8.3.5 雙口RAM
- 8.3.6 FIFO存儲器
- 8.3.7 存儲容量的擴展
- 8.4 應用舉例：用存儲器實現(xiàn)字符顯示
- 小結
- 自我檢驗題
- 習題
- 實踐訓練
- 第9章 *可編程邏輯器件
- 9.1 概述
- 9.1.1 PLD的分類
- 9.1.2 PLD的符號
- 9.2 簡單可編程邏輯器件
- 9.2.1 與—或陣列實現(xiàn)組合邏輯函數(shù)的原理
- 9.2.2 SPLD實現(xiàn)時序邏輯電路的原理
- 9.2.3 GAL器件的基本結構及工作原理
- 9.3 復雜可編程邏輯器件
- 9.3.1 傳統(tǒng)CPLD的基本結構
- 9.3.2 基于查找表的CPLD結構
- 9.4 現(xiàn)場可編程門陣列
- 9.4.1 查找表實現(xiàn)邏輯函數(shù)的基本原理
- 9.4.2 FPGA的一般結構
- 9.5 可編程邏輯器件的一般開發(fā)流程
- 9.6 應用舉例：基于FPGA籃球競賽24s定時器電路設計
- 小結
- 自我檢驗題
- 習題
- 實踐訓練
- 第10章 數(shù)模轉換器和模數(shù)轉換器
- 10.1 D/A轉換器
- 10.1.1 權電阻網絡D/A轉換器
- 10.1.2 倒T形電阻網絡D/A轉換器
- 10.1.3 權電流型D/A轉換器
- 10.1.4 電阻串聯(lián)分壓式D/A轉換器 1
- 10.1.5 D/A轉換器的主要技術指標
- 10.2 A/D轉換器
- 10.2.1 A/D轉換的一般工作過程
- 10.2.2 并行比較型A/D轉換器
- 10.2.3 逐次比較型A/D轉換器
- 10.2.4 雙積分式A/D轉換器
- 10.2.5 A/D轉換器的主要技術指標
- 10.3 應用舉例：可編程波形產生器
- 小結
- 自我檢驗題
- 習題
- 實踐訓練
- 第11章 脈沖波形的變換與產生
- 11.1 555定時器
- 11.1.1 555定時器的電路結構
- 11.1.2 555定時器的工作原理
- 11.2 施密特觸發(fā)電路
- 11.2.1 用555定時器組成的施密特觸發(fā)電路
- 11.2.2 集成施密特觸發(fā)電路
- 11.2.3 施密特觸發(fā)電路的應用
- 11.3 單穩(wěn)態(tài)電路
- 11.3.1 用555定時器組成的單穩(wěn)態(tài)電路
- 11.3.2 集成單穩(wěn)態(tài)電路
- 11.3.3 單穩(wěn)態(tài)電路的應用
- 11.4 多諧振蕩電路
- 11.4.1 用555定時器組成的多諧振蕩電路
- 11.4.2 用施密特觸發(fā)電路組成的多諧振蕩電路
- 11.4.3 石英晶體多諧振蕩電路
- 11.5 應用舉例：雙音報警電路
- 小結
- 自我檢驗題
- 習題
- 實踐訓練
- 參考文獻
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數(shù)字電子技術基礎（微課版 支持AR交互）是2023年由人民郵電出版社出版,作者華中科技大學電子技術課程組 組編。
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本書是將紙質內容、視頻講解、功能模擬、應用仿真、電子文檔等緊密結合的新形態(tài)教材，可以支撐高校開展線上線下混合式教學。本書以理實一體的方式，結合Multisim仿真手段闡述邏輯代數(shù)基礎、組合邏輯電路、時序邏輯電路等數(shù)字電路內容。本書共10章，分別為緒論、數(shù)制和碼制、邏輯代數(shù)、門電路、組合邏輯電路、觸發(fā)器、時序邏輯電路、計數(shù)器、存儲器、矩形脈沖。本書既注重理論知識的深入討論，又突出課程的實踐性與新穎性
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